問答題
如圖所示為N溝道結(jié)型結(jié)構(gòu)的場(chǎng)效應(yīng)管放大電路中,已知VP=-4v,IDSS=1mA,VDD=16v,RG1=160kΩ,RG2=40kΩ,RG=1MΩ,RD=10kΩ,RS=8kΩ,RL=1MΩ。試求:
(1)靜態(tài)工作點(diǎn)Q
(2)畫出微變等效電路
(3)電壓放大倍數(shù)Au
(4)輸入電阻Ri、輸出電阻Ro
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假設(shè)NEMOSFET已工作在飽和區(qū),若uDS繼續(xù)增大時(shí),溝道夾斷點(diǎn)向漏極移動(dòng)。
題型:判斷題
在下圖中如果輸入輸出均有電容耦合,則將RG的阻值由10MΩ替換為1MΩ時(shí),柵極直流電壓將會(huì)(),漏極直流電流將會(huì)(),輸入電阻將會(huì)()。
題型:?jiǎn)雾?xiàng)選擇題
?CS、CG和CD三種組態(tài)中,最適合做電壓放大器的還是CS放大器。
題型:判斷題
?5.1K±5%歐姆的五環(huán)電阻的色環(huán)序列為()。
題型:?jiǎn)雾?xiàng)選擇題
可以通過新增以下哪些類型文件添加ChipScope調(diào)試IP核?()
題型:多項(xiàng)選擇題
?CG放大器的性能描述合理的是()。
題型:?jiǎn)雾?xiàng)選擇題
?CS放大器中引入源極電阻RS,其作用有()。?
題型:多項(xiàng)選擇題
CD放大器因?yàn)樵礃O輸出信號(hào)幾乎與柵極輸入信號(hào)變化一致,因此被稱為“源極跟隨器”。
題型:判斷題
?verilogHDL中已經(jīng)預(yù)先定義了的門級(jí)原型的符號(hào)有()。
題型:多項(xiàng)選擇題
?TTL或非門組成的邏輯電路如圖所示,當(dāng)輸入為以下哪種狀態(tài)時(shí)會(huì)出現(xiàn)冒險(xiǎn)現(xiàn)象?()
題型:?jiǎn)雾?xiàng)選擇題