A.2個(gè)時(shí)鐘周期
B.4個(gè)時(shí)鐘周期
C.6個(gè)時(shí)鐘周期
D.8個(gè)時(shí)鐘周期
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A.
B.
C.
D.
A.數(shù)據(jù)總是先于地址出現(xiàn)。
B.地址總是先于數(shù)據(jù)出現(xiàn)。
C.數(shù)據(jù)與地址同時(shí)出現(xiàn)。
D.地址與數(shù)據(jù)出現(xiàn)的先后是隨機(jī)的。
A.CPU給出的。
B.存儲(chǔ)器給出的。
C.CPU和存儲(chǔ)器輪流給出的。
D.CPU和存儲(chǔ)器共同給出的。
A.使CPU復(fù)位,高電平有效。
B.CPU使其它器件復(fù)位,高電平有效。
C.使CPU復(fù)位,低電平有效。
D.CPU使其它器件復(fù)位,低電平有效。
A.CPU向其它主設(shè)備請(qǐng)求使用總線。
B.其它主設(shè)備向CPU請(qǐng)求使用總線。
C.CPU允許其它主設(shè)備使用總線。
D.其它主設(shè)備允許CPU使用總線。
最新試題
MSP430單片機(jī)的ADC12轉(zhuǎn)換結(jié)果緩沖的寄存器有()個(gè)。
在嵌入式應(yīng)用系統(tǒng)中,模擬I2C時(shí)序擴(kuò)展比硬件I2C通信擴(kuò)展具有更大的靈活性。
在IN和OUT指令中,當(dāng)端口號(hào)大于FFH(255)時(shí),必須通過()間接給出。
某存儲(chǔ)器系統(tǒng)要求采用3:8譯碼器對(duì)A19~A15進(jìn)行全譯碼,需要()片。
指令LEA BX,TABLE等價(jià)于指令MOV BX,OFFSET TABLE。()
8255A的端口地址線是A0、A1,所以端口地址為0,1,2,3。()
ROL、ROR、RCL或RCR指令中的目的操作數(shù)可以是8/16位的寄存器或存儲(chǔ)器。()
I2C總線的兩條信號(hào)線的名稱是()和()。
嵌入式系統(tǒng)接口擴(kuò)展的4種基本方法是()、()、()和通信擴(kuò)展。
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