如下圖所示的反饋電路,試求:
(1)用瞬時(shí)極性法在電路圖上標(biāo)出極性,并指出反饋的類(lèi)型;
(2)說(shuō)明反饋對(duì)輸入電阻和輸出電阻的影響;
(3)在深度負(fù)反饋條件下的閉環(huán)電壓放大倍數(shù)。
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最新試題
一塊通用面包板,公共條是三?四?三分段連通型,那么這塊板上最多有()個(gè)插孔在內(nèi)部是連通在一起的。
I=0.5mA,Vt=1.5V,k′n(W/L)=1mA/V2,VA足夠大。輸入輸出信號(hào)均通過(guò)電容耦合進(jìn)行傳輸(注意圖中未畫(huà)出電容),要實(shí)現(xiàn)增益為15倍的放大電路,則RD=()kΩ。?
?電路如圖所示,如果電容C2開(kāi)路,則MOSFET的漏極直流電壓將會(huì)(),漏極交流電壓將會(huì)(),增益將會(huì)()。
在下圖中如果輸入輸出均有電容耦合,則將RG的阻值由10MΩ替換為1MΩ時(shí),柵極直流電壓將會(huì)(),漏極直流電流將會(huì)(),輸入電阻將會(huì)()。
?verilogHDL的基本結(jié)構(gòu)中通常需要進(jìn)行模塊范圍的定義,VerilogHDL的模塊范圍的定義的開(kāi)始和結(jié)束方式是()。
?6位7段數(shù)碼管動(dòng)態(tài)顯示模塊如圖,要求人眼看到所有數(shù)碼管同時(shí)顯示各自對(duì)應(yīng)的數(shù)字,控制數(shù)碼管位選信號(hào)的動(dòng)態(tài)掃描時(shí)鐘信號(hào)頻率約為多少?()
可以通過(guò)新增以下哪些類(lèi)型文件添加ChipScope調(diào)試IP核?()
?CS放大器中引入源極電阻RS,其作用有()。?
?數(shù)字頻率計(jì)采用4個(gè)數(shù)字的BCD碼計(jì)數(shù)器,若采樣時(shí)間0.01s,那么它能夠測(cè)量的最大頻率是多少?()
?CD放大器的性能特征有()。?