將十進(jìn)制數(shù)
（1）+107/128
（2）―35/64
化成二進(jìn)制數(shù)，再寫出各自的原碼、反碼、補碼表示（符號位和數(shù)值位共8位）。
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下圖為m×n的RAM，WE及ME的電位分別為（）時，為數(shù)據(jù)寫入。
A.WE=1，ME=0
B.WE=1，ME=1
C.WE=0，ME=0
D.WE=0，ME=1
如圖所示總線結(jié)構(gòu)的原理圖，4個寄存器A，B，C和D，其控制字CON=（）
A.W1W2W3W4
B.LAEALBEBLCECLDEDCLK
C.LAEALBEBLCECLDED
MDR和MAR以及RAM的聯(lián)系如圖所示，MDR和MAR分別是（）位的寄存器。
A.8，8
B.8，12
C.12，8
D.12，12
A.1024個二進(jìn)制符號
B.1000個二進(jìn)制符號
C.1024個字節(jié)
D.1000個字節(jié)
A.00H；34H
B.00H；12H
C.12H；00H
D.12H；34H
最新試題
MOV指令執(zhí)行之后將源操作數(shù)（字或字節(jié)）傳送到目的操作數(shù)。（）
MSP430單片機的JTAG引腳可用于程序下載和在線調(diào)試。（）
下列選項中不屬于使用中斷的優(yōu)勢的選項是（）。
通過條件轉(zhuǎn)移指令JXX可以實現(xiàn)分支結(jié)構(gòu)程序的編寫。（）
SPI總線的4個信號是（）、（）、（）和/CS或/SS。
指令A(yù)DD AL，6[BP][DI]是錯誤的。（）
I2C總線的多主機仲裁是依靠兩條信號線的開漏輸出與上位電阻形成的（）實現(xiàn)的。
只要讀取8086CPU存儲器偶地址存儲體內(nèi)容時，BHE#=1，A0=0。（）
MSP430單片機的ADC12轉(zhuǎn)換結(jié)果緩沖的寄存器有（）個。
I2C總線的通信速率僅由主機確定。