單項(xiàng)選擇題CPU在執(zhí)行IN AL,DX指令時(shí),DX的內(nèi)容輸出到()。
A.地址總線
B.數(shù)據(jù)總線
C.存儲(chǔ)器
D.寄存器
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1.單項(xiàng)選擇題軟中斷INT n(n=10~FFH)的優(yōu)先級(jí)排列原則是()。
A.n值越小級(jí)別越高
B.無優(yōu)先級(jí)別
C.n值越大級(jí)別越高
D.隨應(yīng)用而定
2.單項(xiàng)選擇題8086CPU對(duì)I/O接口編址采用()
A.I/O端口和存儲(chǔ)器統(tǒng)一編址
B.I/O端口和寄存器統(tǒng)一編址
C.I/O端口單獨(dú)編址
D.輸入和輸出口分別編址
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SPI總線有四工作模式,取決于()和()這兩位的組合。
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要組成32M×8bit的存儲(chǔ)器,需要1M×4bit的存儲(chǔ)芯片共()片。
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在一個(gè)較短的時(shí)間間隔內(nèi),CPU訪問存儲(chǔ)器時(shí),無論是存取指令還是存取數(shù)據(jù),所訪問的存儲(chǔ)單元都趨于聚集在一個(gè)較小的連續(xù)區(qū)域中,而對(duì)此范圍以外的地址訪問甚少的現(xiàn)象就稱為程序訪問的()性。
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8255A的端口地址線是A0、A1,所以端口地址為0,1,2,3。()
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