A.數(shù)據(jù)寄存器
B.通用寄存器或累加器
C.程序狀態(tài)字
D.地址寄存器
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A.1
B.2
C.4
D.8
A.程序計(jì)數(shù)器
B.指令寄存器
C.地址寄存器
D.地址譯碼器
A.程序計(jì)數(shù)器
B.指令寄存器
C.地址寄存器
D.地址譯碼器
A.3個(gè)階段執(zhí)行時(shí)間之和
B.3個(gè)階段執(zhí)行時(shí)間的平均值
C.3個(gè)階段執(zhí)行時(shí)間的最小值
D.3個(gè)階段執(zhí)行時(shí)間的最大值
A.為0
B.為1個(gè)周期
C.相等
D.不等
最新試題
計(jì)算機(jī)的內(nèi)存儲器與外存儲器相比,內(nèi)存儲器(1)。內(nèi)存儲器可與CPU(2)交換信息。內(nèi)存儲器可分為(3)和ROM??瞻祝?)處應(yīng)選擇()
計(jì)算機(jī)的存儲器采用多級方式是為了()。
指令周期是指()。
單地址指令中為了完成兩個(gè)數(shù)的算術(shù)運(yùn)算,除地址碼指明的一個(gè)操作數(shù)外,另一個(gè)數(shù)常需采用()。
在高速計(jì)算機(jī)中,廣泛采用流水線技術(shù)。例如,可以將指令執(zhí)行分成取指令、分析指令和執(zhí)行指令3個(gè)階段,不同指令的不同階段可以(1)執(zhí)行;各階段的執(zhí)行時(shí)間最好(2);否則在流水線運(yùn)行時(shí),每個(gè)階段的執(zhí)行時(shí)間應(yīng)取(3)??瞻祝?)處應(yīng)選擇()
若內(nèi)存按字節(jié)編址,用存儲容量為4Kb×8的存儲器芯片構(gòu)成地址編號8000H至FFFFH的內(nèi)存空間,則至少需要()片。
下列部件中不屬于輸入設(shè)備的有(1)。既可作為輸入設(shè)備,又可以作為輸出設(shè)備的是(2)??瞻祝?)處應(yīng)選擇()
運(yùn)算器是CPU的核心部件之一,其主要功能是()。
在計(jì)算機(jī)中,保存當(dāng)前正在執(zhí)行的指令的寄存器為(1),存放當(dāng)前指令地址的寄存器叫(2)。在順序執(zhí)行指令的情況下(存儲器按字節(jié)編址,指令字長32位),每執(zhí)行一條指令,使程序計(jì)數(shù)器自動加(3)。算術(shù)邏輯運(yùn)算的結(jié)果通常放在(4)中??瞻祝?)處應(yīng)選擇()
如果主存容量為16MB,且按字節(jié)編址,表示該主存地址至少應(yīng)需要()位。