A.CPU訪問存儲(chǔ)器的時(shí)間是由存儲(chǔ)器的容量決定的，存儲(chǔ)器容量越大，訪問存儲(chǔ)器所需的時(shí)間越長(zhǎng)
B.大多數(shù)個(gè)人計(jì)算機(jī)中可配置的內(nèi)存容量?jī)H受地址總線位數(shù)限制
C.因?yàn)閯?dòng)態(tài)存儲(chǔ)器是破壞性讀出，所以必須不斷地刷新
D.一般情況下，ROM和RAM在存儲(chǔ)體中是統(tǒng)一編址的
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A.程序計(jì)數(shù)器
B.指令寄存器
C.地址寄存器
D.地址譯碼器
A.進(jìn)行加法運(yùn)算，因?yàn)樗械挠?jì)算都可以轉(zhuǎn)變?yōu)榧臃?br />
B.進(jìn)行整數(shù)運(yùn)算和浮點(diǎn)數(shù)運(yùn)算
C.執(zhí)行用二進(jìn)制編寫的程序
D.進(jìn)行算術(shù)運(yùn)算和邏輯運(yùn)算
A.16
B.20
C.24
D.32
A.RAM
B.EPROM
C.CD-ROM
D.SRAM
A.順序
B.重疊
C.循環(huán)
D.并行
A.960
B.873
C.1371
D.480
A.地址譯碼器
B.指令譯碼器
C.地址寄存器
D.指令寄存器
A.繪圖儀
B.鼠標(biāo)器
C.條形碼閱讀器
D.鍵盤
A.指令寄存器IR
B.程序計(jì)數(shù)器PC
C.算術(shù)邏輯單元ALU
D.程序狀態(tài)字寄存器PSW
A.不
B.直接
C.部分
D.間接
最新試題
CPU組成中不包括（）。
在高速計(jì)算機(jī)中，廣泛采用流水線技術(shù)。例如，可以將指令執(zhí)行分成取指令、分析指令和執(zhí)行指令3個(gè)階段，不同指令的不同階段可以（1）執(zhí)行；各階段的執(zhí)行時(shí)間最好（2）；否則在流水線運(yùn)行時(shí)，每個(gè)階段的執(zhí)行時(shí)間應(yīng)?。?）。空白（1）處應(yīng)選擇（）
下列部件中不屬于輸入設(shè)備的有（1）。既可作為輸入設(shè)備，又可以作為輸出設(shè)備的是（2）?？瞻祝?）處應(yīng)選擇（）
在計(jì)算機(jī)中，保存當(dāng)前正在執(zhí)行的指令的寄存器為（1），存放當(dāng)前指令地址的寄存器叫（2）。在順序執(zhí)行指令的情況下（存儲(chǔ)器按字節(jié)編址，指令字長(zhǎng)32位），每執(zhí)行一條指令，使程序計(jì)數(shù)器自動(dòng)加（3）。算術(shù)邏輯運(yùn)算的結(jié)果通常放在（4）中?？瞻祝?）處應(yīng)選擇（）
在計(jì)算機(jī)中，保存當(dāng)前正在執(zhí)行的指令的寄存器為（1），存放當(dāng)前指令地址的寄存器叫（2）。在順序執(zhí)行指令的情況下（存儲(chǔ)器按字節(jié)編址，指令字長(zhǎng)32位），每執(zhí)行一條指令，使程序計(jì)數(shù)器自動(dòng)加（3）。算術(shù)邏輯運(yùn)算的結(jié)果通常放在（4）中?？瞻祝?）處應(yīng)選擇（）
運(yùn)算器是CPU的核心部件之一，其主要功能是（）。
在計(jì)算機(jī)中，保存當(dāng)前正在執(zhí)行的指令的寄存器為（1），存放當(dāng)前指令地址的寄存器叫（2）。在順序執(zhí)行指令的情況下（存儲(chǔ)器按字節(jié)編址，指令字長(zhǎng)32位），每執(zhí)行一條指令，使程序計(jì)數(shù)器自動(dòng)加（3）。算術(shù)邏輯運(yùn)算的結(jié)果通常放在（4）中?？瞻祝?）處應(yīng)選擇（）
指令周期是指（）。
下列部件中不屬于輸入設(shè)備的有（1）。既可作為輸入設(shè)備，又可以作為輸出設(shè)備的是（2）。空白（1）處應(yīng)選擇（）
在CPU的寄存器中，PSW用來存放（）。