A.輸出信號與輸入信號異步
B.各觸發(fā)器翻轉(zhuǎn)異步
C.輸入信號與時鐘脈沖異步
D.預(yù)置數(shù)控制與時鐘信號異步
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A.雙拍接收寄存器存前要清零,單拍不必
B.單拍接收寄存器存前要清零,雙拍不必
C.兩者都必須清零
D.兩者都不必清零
A.同步計數(shù)器
B.數(shù)碼寄存器
C.譯碼器
D.異步寄存器
A.多諧振蕩器
B.施密特觸發(fā)器
C.單穩(wěn)態(tài)觸發(fā)器
D.石英晶體多諧振蕩器
A.同步型
B.計數(shù)型
C.移位型
D.異步型
A.置最小數(shù)法
B.反饋復(fù)位法
C.反饋預(yù)置
D.時鐘禁止
最新試題
如果把D觸發(fā)器的輸出Q反饋連接到輸入D,則輸出Q的脈沖波形的頻率為CP脈沖頻率f的()。
簡述用譯碼器或多路選擇器實現(xiàn)組合邏輯電路的不同之處。
以下代碼中為無權(quán)碼的為()。
兩個與非門構(gòu)成的基本RS觸發(fā)器,當(dāng)Q=1、Q=0時,兩個輸入信號R=1和S=1。觸發(fā)器的輸出Q會()。
27系列EPROM存儲的數(shù)據(jù)是()可擦除的。
判斷如下VHDL的操作是否正確,如不正確,請改正。字符a和b的數(shù)據(jù)類型是BIT,c是INTEGER,執(zhí)行c<=a+b。
一個VHDL模塊是否必須有一個實體和一個結(jié)構(gòu)體?是否可以有多個實體和結(jié)構(gòu)體?簡述它們的作用。
用1M×4的DRAM芯片通過()擴(kuò)展可以獲得4M×8的存儲器。
試提出數(shù)字頻率計的三種設(shè)計方案,比較各種方案的特點。如果用HDPLD來實現(xiàn),設(shè)計方案是最佳嗎?簡述理由。
利用2個74LS138和1個非門,可以擴(kuò)展得到1個()線譯碼器。