A.主從JK觸發(fā)器
B.主從D觸發(fā)器
C.同步RS觸發(fā)器
D.邊沿D觸發(fā)器
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A.冒險(xiǎn)競(jìng)爭(zhēng)
B.安全競(jìng)爭(zhēng)
C.功能競(jìng)爭(zhēng)
D.邏輯競(jìng)爭(zhēng)
A.集成3線－8線譯碼器
B.集成3線－8線數(shù)據(jù)選擇器
C.集成8線－3線譯碼器
D.集成3線－8線數(shù)據(jù)分配器
A.8421BCD編碼器
B.二進(jìn)制編碼器
C.二－十進(jìn)制編碼器
D.十進(jìn)制編碼器
A.變量譯碼器
B.優(yōu)先譯碼器
C.碼制變換譯碼器
D.顯示譯碼器
A.高電平
B.高阻
C.脈沖
D.低電平
最新試題
TTL與非門輸出高電平的參數(shù)規(guī)范值是（）
判斷如下VHDL的操作是否正確，如不正確，請(qǐng)改正。字符a和b的數(shù)據(jù)類型是BIT，c是INTEGER，執(zhí)行c＜=a+b。
試提出數(shù)字頻率計(jì)的三種設(shè)計(jì)方案，比較各種方案的特點(diǎn)。如果用HDPLD來(lái)實(shí)現(xiàn)，設(shè)計(jì)方案是最佳嗎？簡(jiǎn)述理由。
簡(jiǎn)述用譯碼器或多路選擇器實(shí)現(xiàn)組合邏輯電路的不同之處。
什么是觸發(fā)器的空翻現(xiàn)象，如何避免空翻？
ROM可以用來(lái)存儲(chǔ)程序、表格和大量固定數(shù)據(jù)，但它不可以用來(lái)實(shí)現(xiàn)（）。
一個(gè)16選一的數(shù)據(jù)選擇器，其地址輸入（選擇控制輸入）端有（）個(gè)。
TTL與非門輸出低電平的參數(shù)規(guī)范值是（）
10-4線優(yōu)先編碼器允許同時(shí)輸入（）路編碼信號(hào)。
用1M×4的DRAM芯片通過(guò)（）擴(kuò)展可以獲得4M×8的存儲(chǔ)器。