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【簡答題】繪圖題:用邏輯門畫出D觸發(fā)器。
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【論述題】說說靜態(tài)、動(dòng)態(tài)時(shí)序模擬的優(yōu)缺點(diǎn)。
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【論述題】給出某個(gè)一般時(shí)序電路的圖,有Tsetup、Tdelay、Tck->q,還有clock的delay,寫出決定最大時(shí)鐘的因素,同時(shí)給出表達(dá)式。
答案:
T+Tclkdealy>Tsetup+Tco+Tdelay;
Thold>Tclkdelay+Tco+Tdel...
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